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Chapter 3: DC and Switching Characteristics for MAX V Devices
Timing Model and Specifications
Figure 3–5. UFM Erase Waveform
3–19
ARShft
t ASU
t ACLK
9 Address Bits
t AH
ARClk
ARDin
DRShft
DRClk
DRDin
DRDo u t
OSC_E N A
t ADS
t ADH
Program
Erase
B u sy
t OSCS
t EB
t OSCH
t BE
t EPMX
Table 3–25. Routing Delay Internal Timing Microparameters for MAX V Devices
5M40Z/ 5M80Z/ 5M160Z/
5M240Z/ 5M570Z
5M1270Z/ 5M2210Z
Routing
C4
C5, I5
C4
C5, I5
Unit
Min
Max
Min
Max
Min
Max
Min
Max
t C4
t R4
t LOCAL
—
—
—
860
655
1,143
—
—
—
1,973
1,479
2,947
—
—
—
561
445
731
—
—
—
690
548
899
ps
ps
ps
External Timing Parameters
External timing parameters are specified by device density and speed grade. All
external I/O timing parameters shown are for the 3.3-V LVTTL I/O standard with the
maximum drive strength and fast slew rate. For external I/O timing using standards
other than LVTTL or for different drive strengths, use the I/O standard input and
output delay adders in Table 3–32 on page 3–23 through Table 3–36 on page 3–25 .
f For more information about each external timing parameters symbol, refer to
AN629: Understanding Timing in Altera CPLDs .
May 2011
Altera Corporation
MAX V Device Handbook
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